文档介绍：天津职业技术师范大学电子工程学院
DSP技术
Digital Signal Processor
数字信号处理器
于万霞
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第二章 DSP硬件结构
在上一章中。。。
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TMS320C54XX硬件结构特点★
TMS320C55XX硬件结构特点
在这一章中,我们介绍:
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TMS320系列产品命名
TMS320 C 5402 T GDK ( ) 100
采用的技术器件代号版本封装温度范围速度
C=CMOS
E=CMOS EPROM
F=CMOS Flash EEPROM
LC=低电压CMOS()
LF=低电压Flash EEPROM
VC=低电压CMOS[()/]
UC=低电压CMOS[()/]
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§2-1 ‘C54x DSP硬件结构
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DSP模型
DSP=CPU+总线+存储器+片上外设
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多总线结构,三组16-bit数据总线和一组程序总线
40-bit算术逻辑单元(ALU),包括一个40-bit的桶形移位器和两个独立的40-bit累加器
17x17-bit并行乘法器,连接一个40-bit的专用加法器。可用来进行非流水单周期乘/加(MAC)运算
一、C54X的结构特点
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比较、选择和存储单元(CSSU)用于Viterbi运算器的加/比较选择
指数编码器在一个周期里计算一个40-bit累加器值的指数值
两个地址发生器中有八个辅助寄存器和两个辅助寄存器算术单元(ARAUS)
数据总线具有总线保持特性
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