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DSP数字时钟设计说明(共17页).doc

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DSP数字时钟设计说明(共17页).doc

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课 程 设 计 报 告时,相应的发光二极管恒定的导通或截止。该方式每一位都需要一个8 位输出口控制。静态显示时较小的电流能获得较高的亮度,且字符不闪烁。但当所显示的位数较多时,静态显示所需的I/O口太多,造成了资源的浪费。
方案二:动态显示。所谓动态显示就是一位一位的轮流点亮各个位,对于显示器的每一位来说,每隔一段时间点亮一次。利用人的视觉暂留功能可以看到整个显示,但必须保证扫描速度足够快,字符才不闪烁。显示器的亮度既与导通电流有关,也于点亮时间与间隔时间的比例有关。调整参数可以实现较高稳定度的显示。动态显示节省了I/O口,降低了能耗。
从节省I/O口和降低能耗出发,本设计采用方案二。
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(三)秒时间显示方式选择方案
本次设计的延时可以采用部定时器与软件结合的1秒延时,也可以直接编写一个延时程序,实现1秒延时。
方案一:本方案采用部定时器实现1秒延时。原理为:在单片机部存储器设三个字节分别存放时钟的时、分、秒信息。利用定时器与软件结合实现1秒定时中断,每产生一次中断,存储器相应的秒值加1;若秒达到60,则将其清零,并将相应的分加1;若分达到60,则清零分,并将时加1;若值达到24,则将十字节清零。
方案二:本方案完全用软件实现1秒延时。原理为:编写一个延时函数DELAY,用for语句实现秒值循环从0加到60,秒每加1,调用一次延时函数,当秒值大于60,则将分加1,当分加到60,则将分赋0值,并将时加1,当时加到24,将时赋0值。本方案采用的延时方法编程简单,容易理解。
结论:根据两种方案的比较,第二种方案编写程序简单易懂,所以采用第二种方案。
硬件设计
(一)总体思路
DSP2407最小系统是整个芯片能正常运行的最基本要求,首先由 DSP最小系统的设计包括电源转换电路、复位电路等组成。然后利用TMS320LF2407芯片制作简易电子时钟,利用芯片上的定时器编写1ms的时间子程序,继而写出主函数程序。总的模块由6个LED数码管显示、四个按键调试时间、数码管驱动模块74HC273及数码管位选模块74HC138构成。
图1 系统框图
(二)组件介绍

(1). 高性能静态CMOS技术,,指令周期为33ns
(2).片有高达32K字的FLASH程序存储器
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(3).2KB SARAM,544字DARAM,外扩64千字的程序ROM,64千字的数据RAM
(4).两个事件管理器EVA和EVB
(5).可扩展外部存储器总共192K字空间:64K程序存储空间,64K字数据存储器空间,64K字I/O寻址空间
(6).0看门狗定时模块
(7).10位A/D转换器
(8).控制局域网络CAN模块
(9).串行通信接口SCI模块
(10).16位串行外设SPI接口模块
(11).基于锁相环PLL的时钟发生器
(12).高达40个可单独编程或复用的通用I/O引脚
(13).5个外部中断
(14).电源管理包括3种低功耗模式,能独立地将外设器件转入低功耗工作模式
图2 TMS320LF2407
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2. 位选芯片74HC138
74HC138是一款高速CMOS器件,74HC138引脚兼容低功耗肖特基TTL(LSTTL)系列。
74HC138可充当一个8输出多路分配器,未使用的使能输入端必须保持绑定在各自合适的高有效或低有效状态。74HC138与74HC238逻辑功能一致,只不过74HC138为反相输出。74HC138译码器可接受3位二进制加权地址输入(A, B和C),并当使能时,提供8个互斥的低有效输出(Y0至Y7)。74HC138特有3个使能输入端:两个低有效(-S2和-S3)和一个高有效(S1)。除非S2和S3置低且S1置高,否则74H

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