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cadencePCB画图(傻瓜教程快速入门)
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cadence画PCB板傻瓜教程(转帖)
与其余画图软件相同,OrCAD以Project来管理各种设计文件。点击开始菜单,而后挨次是所有程序—打开cadence软件—》一般采纳DesignEntryCIS,点
击Ok进入CaptureCIS。接下来是File--New--Project,在弹出的对话框中填入工程名、路径等等,点击Ok进入设计界面。
新建工程后打开的是默认的原理图文件SCHEMATIC1PAGE1,右边有工具栏,用于搁置元件、画线和增加网络等等,用法和Protel近似。点击上侧工具栏的Projectmanager(文件夹树图标)也许是在操作界面的右边都能看到进入工程管理界面,在这里可以改正原理图文件名、设置原理图纸张大小和增加原理图库等等。
1)改正原理图纸张大小:
双击SCHEMATIC1文件夹,右键点击PAGE1,选择Schematic1PageProperties,在PageSize中可以选择单位、大小等;
2)增加原理图库:
File--New--Library,可以看到在Library文件夹中多了一个library
1."olb的原理图库文件,右键单击该文件,选择Save,更名存盘;(注
意:
在自己话原理图库也许封装库的时候,在增加引脚的时候,最好是画从前设定好栅格等参数,要不然很可能出现你画的封装,很可能在原理图里面布线的时候通但是,无法对齐,连不上线!)
3)增加新元件:
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常用的元件用自带的(比方说电阻、电容的),好多时候都要自己做元
件,也许用他人做好的元件。右键单击刚刚新建的olb库文件,选NewPart,或
是NewPartFromSpreadsheet,后者以表格的方式建立新元件,对于画管脚特多
的芯片元件特别适合,可以直接从芯片Datasheet中的引脚描述表格中直接拷贝、粘贴即可(pdf格式的Datasheet按住Alt键可以按列选择),可以批量增加管脚,方便快捷。
4)生成网络表(NetList):
在画板PCB的时候需要导入网络表,在这从前原理图应该差不多竣工了,
剩下的工作就是查缺补漏。可以为元件自动编号,,而后选Tools--Annotate,在弹出的对话框中选定一些编号规则,依据需求进行改正或用默认设置即可。进行DRC检测也是在生成网络表从前的一项重要工作,可以防备出现一些不用要的设计错误。DRC以后可以试试去生成网络表了,还是在工程管理界面下,选Tools--CreateNetlist,可以在弹出的对话框中选择网络表的存放路径,其余默认设置即可,生成网络表的过程中假如出错,
可以通Windows--SessionLog查察出错的原由,(第一次用cadence画板子,免不了会出好多错误,经过查阅报表的错误原由,做好记录,是学好该软件的捷径)比方说有元器件忘了增加封装等。
5)更新元件到原理图:
当元件库中的某个元件改正后需要原理图也同步更新时,可以不用重新放
置元件(万一有100个或更多该元件岂不是要疯了),在工程管理界面下,双
击DesignCache文件夹,选中刚刚改正的元件,右键单击选择UpdateCache,一
路yes下去即可将原理图中该元件所有更新。注意:
在生成网表的时候,常常报错必定要注意,在自己画的原理图库也许是封装库的时候,必定要有系统的存放,依据必定的规则命名,在增加的时候,原件要把自己所画的封装库的路径增加上,要不然,是不可以正确生成网表的。同时,这样方便今后工程的调用
6)一些细节:
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画原理图时的放大和减小分别是按键“i(”ZoomIn)和“o(”ZoomOut)和
Protel有所差别;在创办元件封装的时候,除了GND可以同名之外,不可以有其
他同名的管脚,否者报错,但是貌似报错也没有影响,由于打开OrCAD自带的
元件库时(比方Xilinx的FPGA),也有除GND外的同名管脚;增加网络标号的快捷键是“n,”但是在OrCAD中网络标号无法复制,记得Protel中是可以经过复制已有的网络标号来增加新的网络标号的。
,设定好相关参数
第一是打开PCB编写器——开始--所有程序
--AllegroSP
B15."5--PCBEditor,在弹出的对话框中选择
AllegroPCBDesign610(PCBDesignExpert),而后点击Ok进入PCB编写器。
接下来就是利用导游建立电路板了,包含确立板子的大小、层数、形状等等参数,用导游比较方便。
MinimumPadtoPadspacing)均为
8."00mil,Defaultviapadstack选择via,以后点击Next。此时选择PCB的外
形为Rectangularboard(矩形),点击Next进入矩形PCB的参数设置界面,主要设置的是板子的宽(Width)和高(Height)以及一些限制地域,包含布线同意地域与板子边框的距离和同意摆放元件地域与板子边框的距离(可以分别设置为50和100mil),设置完成后Next,最后点Finish,这一步大功成功。
接上一个步骤,将网络表导入到刚建好的PCB中。在此从前还有一个很重要的工作要做,就是指定PCB封装的路径。记得在画原理图时不过不过在元件属性中填了元件的封装名,还没告诉Allegro元件的PCB封装在哪处,不指定封装路径的话,导入网络表的时候将会出错。点击Setup--UserPreferences,在弹
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出对话框中的Categories中选中Design_paths,分别为padpath和psmpath指定路径,马上PCB元件封装路径增加到padpath和psmpath中,以见告Allegro从你指定的路径找寻封装。(可能不一样的版本,增加的时候会不一样样,但是归根
究竟,就是要要把padpath和psmpath这两个路径增加好封装库)Allegro的一个PCB元件封装会包含几个文件(有些是网络表一定的,有些不是),而不像
Protel那样一个PCB元件库文件可以包含好多的元件封装。如何获取元件的PCB
封装呢,老方法,自己做或是直接用他人做好的。有牛人为Allegro特地做了一
个PCB封装生成器——FPM(FootprintMaker,目前版本是
0."
0.
8."0),也许LP-Viewer,后者我实践过,发现几乎涉及所要用到的封装都能找到,可以生成绝大数常用的PCB封装,十分好用(真是造福道上兄弟们的壮举)。用FPM选好你需要的封装,Make一下,封装就自动做好了,以后还会自动将做好的封装用Allegro打开,便于检查生成的封装对不对。
封装准备好了,可以开始往PCB中导入网络表,点击File--Import--Logic,在Importdirectory中指定在原理图部分生成的网络表文件路径,其余设置使用
默认值即可,点击ImportCadence即可导入网络表。导入失败的话可以经过log文件查察出错原由,改正错误后重复刚刚的过程,直到成功导入网络表。
成功导入网络表以后,可以开始搁置元件。点击菜单Place--Quickplace,在弹出的对话框中使用默认设置,点击Place按钮即可完成元件的搁置。假如遇到有未成功搁置的元件,在Place按钮上方将出现未成功搁置的元件计数,形如:
Unplacesymbolcount:
4。"经过点击右边的Viewlog查察有那些元件未成功搁置。比方PCB元件封装缺乏焊盘将以致搁置失败,经过改正封装以后再次重新搁置即可。
4."布局(布局的方法有好多种,选自己适合的)
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此刻可以依据实质需求在PCB上摆放元件,此时的元件基本上都放在了板子的外边,而且有密密丛丛的飞线(Rats)。为了能更好的摆放元件,可以临时将飞线去掉,方法是点击工具栏中的UnratsAll按钮即可,恢复的方法是右边的
RatsAll按钮。要挪动元件时,一定先点击工具栏中的Move按钮或使用
Shift+F7,进入“挪动”命令模式,同时在界面右边控制面板中的Find标签中勾选
Symbols,而后单击想要挪动的元件,挪动鼠标(元件跟着鼠标挪动)至新位
置,再次单击鼠标完成搁置。此时仍处在Move命令模式下,用相同的方法可
以直接挪动其余元件,按F2或右键菜单Done均可退出Move命令模式(回到
Idle模式)。元件的旋转比较有意思,在挪动元件的时候,右键选择Rotate,元
件中心与鼠标指针拉出一条线,此时用鼠标指针以元件中心画圈,元件跟着开始旋转,转到适合的地址单击鼠标即可确立摆放的方向。布局的时候可以直接从原理图中直接定位某个元件,由于开始的时候元件都是堆在一块了,即设置原理图到PCB的交互。方法是在OrcadCaptureCIS中选择菜单Options--
References,在Miscellaneous标签下勾选EnableIntertoolCommunication即可。当在原理图中选择某个元件后,在PCB中将直接能定位到该元件上(一定是在
Idle模式下)。有时需要把某个元件放在基层,方法是点击菜单Edit--Mirror,进入该命令模式,而后点击想要放到反面的元件即可。
首次使用Allegro画PCB感觉很不****惯(可能是由于****惯了Protel的缘
故),比方其放大和减小PCB快捷键不是PageUp和PageDown了,而是F10和F11(不一样的版本可能有一点改变,
16."3版本的是F11和F12);再如在Protel中挪动PCB图纸可以用鼠标滚
轮(上下挪动)或是Shift加鼠标滚轮(左右挪动),或是鼠标右键或中键按住不放亦可,在Allegro中,只剩下按住鼠标中键还好使,或是使用方向键。自然这些都可以经过相关设置改成自己****惯的方式,“Cadence系统是一个比较开放的系统,它给用户留了比许多的定制空间”。(这一点很优秀,就像傻瓜机和单反的差别)还有一个比较不****惯的地方就是颜色的设置,由于默认设置实在是
太烂,一定改了才看得惯(不然将会崩溃)。点击工具栏中的Color按钮或
Ctrl+F5或是菜单Display--Color/Visibility,在弹出的对话框中可以看到,Allegro将颜色设置分了好几个Group,依据个人****惯分别设置,比方Stack-Up中,可
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以设置Top(顶层)或Bottom(顶层)的Pin(管脚)、Via(过孔)和Etch(走线)为红色和蓝色(Protel中的默认的颜色设置);Geometry中设置Skillscreen_Top(顶层丝印)为黄色;Components中设置
Skillscreen_Top的RefDes(元件的标号)一栏的颜色为黄色。经过一番设置以后,才能感觉比较友善,开始布线,,点击菜单Route--Connect或是快捷键F6即可,可以在右边控制面板中随时改正线宽。在布线的时候经过右键菜单AddVia命令来随时增加过孔,让布线穿越于顶层和基层之间。还还有一个不****br/>惯的地方,焊盘(带孔的)和过孔都是实心的(何以能称之为“孔”),为了是
“孔”,点击菜单Setup--DrawingOptions下的Display标签,选上Displayplatedholes即可。布线的时候自动推挤布线,很不错,别的,可以依据需求设置一些规则拘束,点击Setup--
Constrains,在弹出的对话框中点击Setstandardvalue按钮可以设置焊盘间距、线宽等参数。
制板就是给PCB生产商供给Gerber文件让其把板子给洗出来(近似于洗照片,Gerber文件近似与底片)。在出Gerber从前还一定做一些必需的检测工
作,比方封装有没有画错(主要检核对象),有无未连接的网络等等,,不仔细检测的话到时候极有可能会欲哭无泪的。发现PCB封装错了,改正之,而后在
PCB中更新改好的封装,Place--UpdateSymbols,在Packagesymbols中选上需要更新的封装,选好以后还要选上Updatesymbolpadstacks,最后点击Refresh即可。别的假如打开了On-lineDRC(在规则拘束中,默认是打开的),也需要特别留意一下出现DRC但是的地方,必需的话也要改之。全部无误以后,可以给PCB铺铜,在铺铜前可以对铺铜的参数进行设置,点击菜单
Shape--GlobalDynamicParams,在Shapefill标签页中的
Dynamicfill选项选择Smooth光滑填补,打开Voidcontrols标签页,Artworkformat选择GerberRS274X。而后,点击菜单Shape--Rectangular(辅矩形),此时可以在右边控制面板的Option中设置要铺铜的层,并选择铺铜对应的网络,铺完以后记得删除铺铜死区,Shape--DeleteIslands。至此,画板的工作
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算是完成了,可以出Gerber了。点击Manufature--Artwork,在弹出对话框中打开
GeneralParameters标签,Devicetype选择GerberRS274X,Format中Integerplaces:3,Decimalplaces:5,而后打开FilmControl标签,增加完成所需的film,一般两层板的话需要TOP(顶层走线层)、BOTTOM(基层走线层)、SOLDERMASK_TOP(顶层阻焊层)、SOLDERMASK_BOTTOM(基层阻焊层)、SKILL_TOP(顶层丝印)和SKILL_BOTTOM(基层丝印),增加完所需的底片文件后,设置Undefinelinewidth为8(不知道为什么是这个值),其余设置使用默认值,最后点击CreateArtwork即可,相同可以经过Viewlog按钮查察在生成Gerber文件时的相关记录
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