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姓名
指导教师
专业班级
学院信息工程学院
提交日期
一、实验目的
学****用FPGA实现数字系统的方法
二、实验内容
,QuartusII和VHDL使用练****br/>
三、四位数字频率计的设计

当系统正常工作时,8Hz信号测频控制信号发生器进行信号的变换,产生计数信号,被测信号通过信号整形电路产生
同频率的矩形波,送入计数模块,计数模块对输入的矩形波进行计数,将计数结果送入锁存器中,保证系统可以稳定
显示数据,显示译码驱动电路将二进制表示的计数结果转换成相应的能够在七段数码显示管上可以显示的十进制结果。
在数码显示管上可以看到计数结果。工作原理图如下:

lock模块(锁存器模块):输入clk模拟锁存信号,dd模拟十进制计数器结果;
输出qq的对应显示表明计数结果成功锁存
Consignal模块(控制信号产生模块):
上为8Hz时是仿真结果:输入为clk8Hz时钟信号(模拟);输出分别为clr清零信号、cs片选信号(闸门信号)
和lock锁存信号
下为随意一频率的仿真结果
decoder模块(译码模块):
输入din(未展开):锁存的计数结果,四位二进制数(0000和1111);
输出led7s(未展开):7段显示译码,共阳极输出。
输入din(未展开):锁存的计数结果,十进制(0000--1001);
输出led7s(未展开):7段显示译码,共阳极输出。

(1)器件选定
每个VHD文件经过置顶编译仿真后,通过“File-Create/Update-CreateSymbolFilesforCurrentFile”生
成模块符号,在顶层原理图中调用
(2)管脚锁定
“Assignment-Pins”,在Location中输入DEII对应管脚名。
(3)编程下载
“Tools-Programmer”,将“HandwareSetup”中“HandwareSetting”中双击“USB-Blaster”,并将编程模式确定为
“JTAG”,在“Program/Configure”复选框中打勾。点击Start开始下载。

仿真结果:
数码管结果:将短路片依次接在4Hz、32Hz、128Hz、512Hz、2048Hz等处,数码显像管显示的数字依次为0004、0032、
0128、0512、2048
四、实验小结
实验中遇到什么问题?如何解决?实验收获和建议。
收获和建议:
通过此次为期3天的是大型数电实验,我学会了如何使用quartus2软件,学会了用作图法和程序法
进行简单的实验。了解了DE2开发板的功能和使用方法,将课本中的学到的知识与实际应用结合了
起来,使得知识学****的更加深入。但实验的时间只有3天,对VHDL语言还不是很掌握,建议以后
的实验能让我们有更加多的时间去学****和进行这样的实验
问题与解决方法:
1、实验进行中,对新建的consignal进行仿真,出来的确是前一个程序cnt10的结果
---问题所在:未置于顶层即VHDL模块编译时,应将待编译文件置顶(“Project--SetasTop-LevelEntity”)
再进行编译,否则易产生或者忽视错误。
2、VWF仿真文件的“自动获取输入输出端口(NodeFinder)”时框图中没有对应的输入输出端
-----问题所在:Pins所选类型未选择all(而不是assigned)。注:选择输入输出是不一定要‘>>’全部选择,
可以选择性的选择输入输出总线,这样仿真结果可以更加清晰明了。
3、VWF仿真文件的仿真时间和网格宽度设置好后,可用放大镜功能调节仿真结果的缩放,使结果清晰
4、VWF仿真时提示找不到相应文件
——问题所在:未在SetSimulate选项中确定“Assignment—Device”中得的VWF文件
5、设计载入FPGA器件后,板上未用的LED灯亮,同时蜂鸣器响。为解除这样的情况,应在“Assignment--Device”
中选择“Device&PinOption”按钮,在“UnusedPins”选项卡中的对话框中选择“Asinputtri-stated”
选项。然后重新编译文件,重新下载即可
6、实验编译报错时,转到程序界面,双击报错行,即能在程序界面中显示出错行
7、仿真bdf文件时提示找不到文件
---问题所在:bdf保存时命名应与新建/打开的project的命名相同