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到6个数码管,所以设计一个6进制计数器COUNT6来控制数码管的位选。至于数码管的段选,先将预置8位输入D转化为12位的供3个数码管显示的数组,当COUNT6计数为0时,把第一个12位数组(对应第一个预置数)中的低4位送入译码管的输入端BEDIN;当计数为1时,把中间4位送入译码管的BEDIN;当计数为2时,把高4位送入译码管的BEDIN;当计数为3时,把第二个12位数组(对应第二个预置数)中的低4位送入译码管的输入BEDIN端……如此可实现对输入的数码显示。考虑到实验箱上提供的脉冲是20MHz,既不便于灯的观察又不便于数码显示,所以设计了一个1000Hz的分频器,将脉冲分频为1000Hz的脉冲输入。总体设计原理框图如附录1。7:..=252,B=254。可得到仿真波形,:,A、B预置数输入利用16个拨码开关可实现,A、B各占8个。可调脉宽的输出POUT可接PIN_104,以便用发光二极管的亮灭速度来观察结果。T接3-8译码器的输入SEL,译码器SEG7DEC的输出SEGT接数码管的段选输入端。::..,通过PIN_49~PIN_56对应的8个拨码开关输入控制高电平信号脉宽的预置数(对应于A输入),并显示于数码管1、2、3;再通过PIN_57~PIN_62、PIN_67、PIN_68对应的8个拨码开关输入控制低电平信号脉宽的预置数(对应于B输入),并显示于数码管4、5、6。可观察到,当A较低,而B输入较高时,发光二极管的点亮时间大于熄灭时间;当A较高,B输入较低时,发光二极管的点亮时间少于熄灭时间;当A输入255时,POUT=0,则发光二极管一直保持熄灭状态。也可以将POUT接入到示波器,通过观察示波器的显示波形得到结果。:..,手工设计占了较大的比例。一般都是先按电子系统的具体功能要求进行功能划分,然后对每个子模块画出真值表,用卡诺图进行手工逻辑简化,写出布尔表达式,画出相应的逻辑线路图,再据此选择元器件,设计电路板,最后进行实测与调试。显然,手工设计的缺点让人越来越不可接受。故而,EDA技术变得越来越重要,作为当代大学生,要与时俱进,更要掌握这种电子自动化设计。通过EDA的模拟编译、适配、仿真,可以大大缩短设计周期,降低设计成本。EDA仿真测试技术只需通过计算机就能对所设计的电子系统从各种不同层次的系统性能特点完成一系列准确的测试与仿真操作,在完成实际系统的安装后,还能对系统的目标器件进行所谓边界扫描测试、嵌入式逻辑分析仪的应用,这一切都极大地提高了大规模系统电子设计的自动化程度。至于课设报告中涉及到的WORD排版知识,随着一次次课设的进行,也一点点积累,现在可以说是得心应手。至少在排版时不会遇到障碍。总之本次课设,让我重新熟悉了QuartusⅡ、WORD两个常用软件,也复****了一遍VHDL语言的相关知识,又熟悉了一遍用VHDL语言进行编程的过程。:..潘松,(第2版).北京:清华大学出版社,2007.[2]孟庆辉,刘辉,程继航,:国防工业出版社,2008.[3]:华中科技大学出版社,2009.[4]:人民邮电出版社,2009.[5]王辉,殷颖,陈婷,+:***出版社,2007.:..录1整体原理框图:..2设计程序自加载加LIBRARYIEEE;;LCNT8T8ISPORT(CLK,LD:INSTD_LOGIC;D:ININTEGERRANGE0TO255;CAO:OUTSTD_LOGIC);T8;T8ISSIGNALCOUNT:INTEGERRANGE0TO255;BEGINPROCESS(CLK)BEGINIFCLK'EVENTANDCLK='1'THENIFLD='1'THENCOUNT<=D;ELSECOUNT<=COUNT+1;ENDIF;ENDIF;ENDPROCESS;PROCESS(COUNT)BEGINIFCOUNT=255THENCAO<='1';ELSECAO<='0';ENDIF;ENDPROCESS;ENDBEHAVE;1000Hz分频LIBRARYIEEE;;;;ENTITYDIVISGENERIC(DATAWIDTH:INTEGER:=25);PORT(CLK:INSTD_LOGIC;QO:OUTSTD_LOGIC);END;ARCHITECTUREBHVOFDIVISSIGNALCOUNT:STD_LOGIC_VECTOR(DATAWIDTH-1DOWNTO0);BEGIN:..PROCESS(CLK)BEGINIFRISING_EDGE(CLK)THENIFCOUNT=20000THENCOUNT<=(OTHERS=>'0');ELSECOUNT<=COUNT+1;IFCOUNT<10000THENQO<='0';ELSEQO<='1';ENDIF;ENDIF;ENDIF;ENDPROCESS;ENDBHV;6进制计数LIBRARYIEEE;;;ENTITYCOUNT6ISPORT(CLK:INSTD_LOGIC;CNTOUT:BUFFERSTD_LOGIC_VECTOR(2DOWNTO0));END;ARCHITECTUREBHVOFCOUNT6ISBEGINPROCESS(CLK)BEGINIFCLK'EVENTANDCLK='1'THENTOUT<5THENCNTOUT<=CNTOUT+1;TOUT<=(OTHERS=>'0');ENDIF;ENDIF;ENDPROCESS;END;将8位预置LIBRARYIEEE;;位数组changeENTITYCHANGEISPORT(D:INSTD_LOGIC_VECTOR(7DOWNTO0);DOUT:OUTSTD_LOGIC_VECTOR(11DOWNTO0));ENDCHANGE;14:..ARCHITECTUREBHVOFCHANGEISBEGINPROCESS(D)BEGINCASEDIS………………ENDCASE;ENDPROCESS;ENDBHV;段选译码器LIBRARYIEEE;;ENTITYSEG7DECISPORT(BEDIN:INSTD_LOGIC_VECTOR(3DOWNTO0);SEGOUT:OUTSTD_LOGIC_VECTOR(6DOWNTO0));ENDSEG7DEC;ARCHITECTUREBHVOFSEG7DECISBEGINPROCESS(BEDIN)BEGINCASEBEDINIS15:..WHENOTHERS=>NULL;ENDCASE;ENDPROCESS;ENDBHV;顶层文件LIBRARYIEEE;;;ENTITYPULSEISPORT(CLK:INSTD_LOGIC;A,B:INSTD_LOGIC_VECTOR(7DOWNTO0);POUT:OUTSTD_LOGIC;SEGT:OUTSTD_LOGIC_VECTOR(6DOWNTO0);CNT:OUTSTD_LOGIC_VECTOR(2DOWNTO0));ENDPULSE;ARCHITECTUREBEHAVEOFPULSEIST8PORT(CLK,LD:INSTD_LOGIC;D:INSTD_LOGIC_VECTOR(7DOWNTO0);CAO:OUTSTD_LOGIC);PONENT;COMPONENTCOUNT6ISPORT(CLK:INSTD_LOGIC;CNTOUT:BUFFERSTD_LOGIC_VECTOR(2DOWNTO0));PONENT;COMPONENTCHANGEISPORT(D:INSTD_LOGIC_VECTOR(7DOWNTO0);DOUT:OUTSTD_LOGIC_VECTOR(11DOWNTO0));PONENT;COMPONENTSEG7DECISPORT(BEDIN:INSTD_LOGIC_VECTOR(3DOWNTO0);SEGOUT:OUTSTD_LOGIC_VECTOR(6DOWNTO0));PONENT;COMPONENTDIVISPORT(CLK:INSTD_LOGIC;QO:OUTSTD_LOGIC);PONENT;16:..SIGNALCAO1,CAO2,CLKO:STD_LOGIC;SIGNALLD1,LD2,PINT:STD_LOGIC;SIGNALBED1:STD_LOGIC_VECTOR(3DOWNTO0);T1:STD_LOGIC_VECTOR(2DOWNTO0);SIGNALDOUT1,DOUT2:STD_LOGIC_VECTOR(11DOWNTO0);BEGINU1:LCNT8PORTMAP(CLK=>CLKO,LD=>LD1,D=>A,CAO=>CAO1);U2:LCNT8PORTMAP(CLK=>CLKO,LD=>LD2,D=>B,CAO=>CAO2);U3:COUNT6PORTMAP(CLK=>TOUT=>CNT1);U4:CHANGEPORTMAP(D=>A,DOUT=>DOUT1);U5:CHANGEPORTMAP(D=>B,DOUT=>DOUT2);U6:SEG7DECPORTMAP(BEDIN=>BED1,SEGOUT=>SEGT);U7:DIVPORTMAP(CLK=>CLK,QO=>CLKO);T1)BEGINT1=0THENBED1<=DOUT1(3DOWNTO0);T1=1THENBED1<=DOUT1(7DOWNTO4);T1=2THENBED1<=DOUT1(11DOWNTO8);T1=3THENBED1<=DOUT2(3DOWNTO0);T1=4THENBED1<=DOUT2(7DOWNTO4);T1=5THENBED1<=DOUT2(11DOWNTO8);ENDIF;ENDPROCESS;CNT<=CNT1;PROCESS(CAO1,CAO2)BEGINIFCAO1='1'THENPINT<='0';ELSIFCAO2'EVENTANDCAO2='1'THENPINT<='1';ENDIF;ENDPROCESS;LD1<=NOTPINT;LD2<=PINT;POUT<=PINT;ENDBEHAVE;17:..武汉理工大学《数字电子技术》课程设计说明书