文档介绍：河北理工大学
计控学院
课程设计报告
报告题目:多功能倒计时牌
课程名称: 电子技术
任课教师:
专业: 07表1
学号:2
姓名:
题目:多功能倒计时牌
1、要求:
设计并用ispLSI1032E实现一个倒计时牌。具有下述功能:
(1)实验台上的六个数码管和四个发光二极管分别显示天,时,分,秒。
(2)能使倒计时牌复位。
(3)能启动或者停止倒计时牌运行。
(4)在倒计时牌停止运行状态下,能修改天,时,分,秒的值。
(5)具有报时功能,整点时喇叭鸣叫六秒钟。
(6)分频器必须保证输出是秒脉冲。
2、提交设计报告说明书
在系统可编程逻辑器件与以前所认识数字电路的区别。
简述用在系统可编程逻辑器件实现数字系统的基本原理。
用ISPLS1032E实现数字电路的基本步骤。设计程序、电路图。
设计详细说明:
顶层电路:名称、功能、设计思想。
低层电路:名称、功能、设计思想。
(5) 仿真结果(包括引脚图)。
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用数字信号完成对数字量进行算术运算和逻辑运算的电路称为数字电路,或数字系统。由于它具有逻辑运算和逻辑处理功能,所以又称数字逻辑电路。普通的逻辑器件只能够实现一定的逻辑功能,不能够由用户根据具体要求进行修改,在系统可编程逻辑器件可以修改或重构数字逻辑在系统(包括增加或修改可编程逻辑器件的I/O引脚),在已经设计和制作的数字系统中,通过在系统可编程逻辑器件的编程控制信号线,直接在线编程和反复修改,并进行现场调试和验证,使得原来不用以改变的硬件设计变得和软件一样灵活,易于修改和调试。
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在系统编程和普通编程的基本操作一样,都是逐行编程。编程寻址和一位操作由地址移位寄存器和数据移位寄存器完成。地址移位寄存器决定行地址,数据位寄存器决定单位地址和单位数据内容,如下图。
当阵列结构有n行,器地址用一个n位的地址移位寄存器来选择。对起始位置编程,先将地址移位寄存器中与0行对应的位置置1,其余置0,让该行被选中。在编程脉冲的作用下,将水平移位寄存器中的数据写入该行。然后将地址移位寄存器移动一位,使阵列的下一行被选中,并将水平移位寄存器中换入下一行的编程数据……
设计准备其目的就是选择合适的ispLSI器件
设计输入将设计者的所设计的电路以开发软件所要求的某种形式表达出来,并输入计算机。
设计检验将设计文件输入以后,应对输入的文件进行检验。
布局和布线在设计检验通过后,便可着手布局和布线,该工作由软件自动完成。
设计仿真 ispEXPECT System 能对所设计的电路进行功能仿真和时序仿真,便于使用者更加方便地观察输出波形及现象。
容丝图生成在该过程中,凡是设计者没有使用的I\O端,都被自动接上有源上拉电阻。
下载编译该过程是将设计阶段生成的JEDEC文件(即容丝图)装入到器件中。
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本设计由一个顶层模块和六个底层模块组成。
顶层模块CLOCK由原理图实现,包含了天,时,分,秒计数器和时钟发生器,整点响铃模块,译码器六个底层模块及若干门电路,并定义了信号与管脚的对应关系。
在使用给定时间后,能够实现对该时间段的倒计时,通过数码显示管显示出相对应的时间,并在整点时通过外接喇叭给出提示,而且能够随时停止和启动倒计时牌,停止时能够对倒计时牌所记时间进行修改。根据秒分时天之间的进制关系设计出相对应的减法器模块,由秒开始依次向分,时,天借位,并通过低位的借位信号给出高位模块信号,使高位模块执行减法运算。当秒对应模块由59减至00时,将会给出一借位信号,此时分所对应的模块减一,即分所对应模块由59减至58………当分所对应模块由59减至00时,同样向小时对应模块给出一借位此时小时对应模块减一,依次执行,最终完成倒计时的功能。
底层电路:
六十进制减法器
通过一个十进制减法器和一个六进制减法器的级联来实现六十进制减法器的设计,十进制减法器做低位片,六进制做高位片,十进制减法器由9减至0后给出一借位信号,让六进制减法器减一………如此执行,当高位片减至零后给出一借位信号,用该信号给两个模块置数,然后在循环执行。
二十四进制减法器
通过两个十进制减法器来实现二十四进制减法器的设计,第一个十进制减法器输入端结成3,做低位片,第二个十进制减法器输入端结2,做高位片,第一个十进制减法器减至0后给出一借位信号,让第二个十进制减法器减一………如此执行,当高位片减至零后给出一借位信号,用该信号给两个模块置数,然后在循环执行。
三十进制减法器
通过一个十进制减法器和一个三进制