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清华大学VLSI7.pptx

上传人:wz_198613 2020/2/6 文件大小:396 KB

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文档介绍

文档介绍:1第七章半定制设计模式2§1 引言按版图设计自动化程度分:手工设计、半自动设计和全自动设计按版图结构及制造方法分:半定制(semi-custom)和全定制(full-custom)。3§2 门阵列、宏单元阵列及门海一、门阵列设计模式母片结构门阵列设计模式(gatearraydesignstyle)又称为母片(masterslice)法。它预先设计和制造好各种规模的母片,如1000门,3000门,5000门,10000门……母片上除其金属连线及引线孔以外的各层图形均是固定不变的,且以阵列形式排列。4母片5基本单元在门阵列母片中,一个基本单元是以三对或五对管子组成,基本单元的高度,宽度都是相等的,并按行排列。6单元库中存放的信息:NAND3电路图逻辑图版图:孔、引线扇入,扇出门延迟时间7单元库单元库中存有上百种不同功能的单元电路,这些单元作为系统设计的基础,可以重复使用。门阵列的生产制造可以分为两个相对独立的过程:第一个过程是母片的制造,同时提供与之配套的单元库。第二个过程是根据用户所要实现的电路,完成母片上电路单元的布局及单元间连线。然后对这部分金属线及引线孔的图形进行制版、流片。8门阵列的设计流程在书P74,。门阵列设计的优点:(1)事先制备母片,使设计周期缩短。(2)母片及库单元都是事先设计好,并经过验证。因此,正确性得到保证。(3)门阵列模式非常规范,自动化程度高。(4)价格低,适合于小批量的ASIC设计。9门阵列设计的缺点:(1)芯片利用率低,70%左右。(2)不够灵活,对设计限制得太多。(3)布通率不能做到100%布通,要人工解决剩线问题。10二、宏单元阵列模式(macro-cellarray)为了提高门阵列的芯片利用率,一种改进的结构是去掉垂直方向的走线通道,跨越单元行的线可以利用空闲栅来完成。

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