文档介绍：歹一鲤些筮指导数师一“竖速塑攫一博七学位沦艾超途堑丝苤兰晁腿ぷ冉ň鸫运埋塞盟羞壁垫盛论文题目学科:专业·一⋯·韭鱼生丞筮一电:■ぼ端一作者蚌名昕存学阱
摘要当前,集成电路产业进入了以纳米工艺为代表的现遇到了以时序收敛为代表的很多全新的问题。特性提出了一种先进的ひ障虏⒓嫒幕贗说腟物⒔⒛P褪褂糜诙嘞頢系统设计中。樯芰顺钛俏⒚坠ひ仗跫禄贗竞说奈锢硎迪值牧鞒蹋压技术等多种技术同时着手的低功耗实现流程。岢隽丝悸切藕磐暾浴猟肮ひ湛杀湫缘纫蛩氐氖毙蚴樟时代,工艺的特征尺寸越来越小,工艺的进步对设计方法学提出了新的挑战。由于设计规模的扩大,芯片的功能设计、仿真、形式验证、测试等都遇到了新的问题。在芯片的物理实现领域,由于特征尺寸的变小,物理实本文介绍了超深亚微米条件下物理实现和验证的流程,根据新工艺的理设计和验证流程,解决了其中关键的时序、功耗、可制造性设计等问题,并同时介绍如何设计可重用核,如何建模的技术。根据该流程实现了位嵌入式本论文的主要工作和创新如下:分析作为核使用时设计流程的关键技术。治隽诵酒凸纳杓剖迪值闹饕7椒ǎ⑻岢雒趴厥敝印⒍嗟和时序验证的流程和方法。在ひ障驴焖俚酱锸樟膊⒈V了流片后成功达到性能要求。岢隽饲度胧酱砥鱅埠说恼捉<际酰⒊晒ττ糜位高性能嵌入式处理器I傻哪P湍茏既访枋鯥埠颂性,符合业界工具标准输入格式并更易于使用,而且模型以加密浙江大学博十学位论文摘爱
的动态压降分析为基础,在传统的时序模型提取中加入动态压降时序模型。准确的模型更有利于低臣缎阅艿钠拦馈接下来的:鹘氐阊芯耙韵鹿ひ瘴锢硎迪值牧鞒蹋蓖;芯核;超深亚微米;物理实现;低功耗设计或接口模型的方式很好地保护了核的知识产权。已有多款使用该处理器的低承酒谡庑┠P土髌晒Γ橹ち四P的正确性和适用性。岢鲆恢挚悸嵌菇档氖毙蚰P吞崛⌒路椒ǎ曰谝糯惴的影响,以得到的最大动态压降,从而得到更准确的核的善核的各种模型,加快杓频慕獭关键词;时序收敛;可制造性设计:建模
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图表目录图硬核实现基本流程⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯一图静态功耗和动态功耗的比例关系⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..图耦合电容占整个线电容的比例⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯~图光刻波长和最小特征尺寸演进图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..图设计抽象层次演变图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..图基于芯核的迪至鞒獭图系统集成流程图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.图毙蜓橹ち鞒獭图低功耗物理设计流程⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..图ǹ资迪治锢砩杓莆冉⌒浴图工艺下通孔优化图例⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.图工艺颗粒缺陷引起的电路失效⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..图鹗艏渚嗤乜怼图鹗艨矶仍龃蟆图杓浦蠭敝由柚檬疽狻图弧硬核的放置方案⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯图褂貌馐曰返牟馐越峁雇肌图嗪薙可测性设计示意⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯一图涑黾八蚬芙诺奶煜咝вΧü懿迦搿图淙牍芙诺奶煜咝вΧü懿迦搿逑到峁狗娇橥肌咛逦锢硎迪滞肌图嗄?镽构架
嗟缪故迪质疽馔肌门控时钟示意图⋯⋯⋯⋯⋯⋯⋯⋯趴厥敝拥ピ=峁埂门控时钟实现流程⋯⋯⋯⋯⋯⋯⋯偶豆挠呕电压区域示意⋯⋯⋯⋯⋯⋯⋯⋯⋯嗟缪沟奈锢硎迪至鞒獭核多电压实现⋯⋯⋯⋯⋯⋯⋯.ヱ畹缛莶迦搿信号串扰导致功能错误⋯⋯⋯⋯⋯信号串扰导致时序错误⋯⋯⋯⋯⋯改变信号线次序⋯⋯⋯⋯⋯⋯⋯⋯≡癫煌愕牧摺减小平行信号线的长度⋯⋯⋯⋯⋯藕磐暾匝橹ち鞒獭讨幸氲幕チ穸缺浠压降对时钟树偏移的影响⋯⋯⋯⋯鹗籼畛涞慕峁故疽狻鹗艨2鄣慕峁故疽狻毙虮浠视刖嗬氲墓叵登摺酒难菇捣植纪肌核产生模型示意⋯⋯⋯⋯⋯⋯⋯P筒毙蚰P吞崛芯核测试环结构⋯⋯⋯⋯⋯⋯⋯~图图图图图图图图图图图图图图图图图图图图图图图图图浙江大学博士学位论文超深哑微米杓埔劣埠私<拔锢硎迪止丶际....................,...,........⋯⋯⋯..⋯⋯⋯一⋯⋯⋯~
的模式⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯图馐阅P筒鞒淌疽馔肌毙蚰P吞崛图核测试环单元⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..的正常模式⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.的模式⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..模式的时序要求⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯图模式的时序要求⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯的安全模式⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯图砥髟赟设计中版图示意图砥髟赟设计中版图示意缏肥迪帧图动态压降影响路径分布图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯绪论
问表模型提取时关键路径延时变化⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..表弧课