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基于FPGA的FSK调制解调器设计毕业设计论文.doc

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基于FPGA的FSK调制解调器设计毕业设计论文.doc

上传人:ttteee8 2020/7/2 文件大小:311 KB

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文档介绍

文档介绍:编号:审定成绩:重庆邮电大学毕业设计(论文)设计(论文)题目:基于FPGA的FSK调制解调器设计学院名称:自动化学生姓名:唐大亮专业:自动化班级:0810904学号:2009212482指导教师:周围答辩组负责人:填表时间:2013年5月重庆邮电大学教务处制ABSTRACT-MZ-* -、・ -刖 n 4第一章 FPGA设计基础 4第一节 FPGA简介 4、背景 4二、 工作原理 5三、 基本特点 5第二节EDA设计平台选择 6一、 EDAI具软件 6二、 QuartusII简介 6第三节硬件描述语言的选择 7一、 HDL概述 7二、 VHDL简介 7三、 HDL开发流程 8第二章FSK调制解调原理 9第一节数字调制技术 9第二节数字调制的分类及特点 9一、 数字调制的分类 9二、 数字信号三种基本调制方式的特点 9第三节2FSK调制解调原理 10一、 2FSK的调制原理 10二、 2FSK信号的解调 12第三章调制解调器系统方案设计 14第一节系统的实现原理 14第二节FSK调制方式的比较 14第三节FSK调制系统设计 14第四节FSK解调系统设计 14第四章软件设计及仿真 14第五章总结 14致谢 14参考文献 14第一章FPGA设计基础第一节FPGA简介一、背景以硬件描述语言(Verilog或VHDL)所完成的电路设计,可以经过简单的综合与布局,快速的烧录至FPGA上进行测试,是现代1C设计验证的技术主流。这些可编辑元件可以被用来实现一些基本的逻辑门电路(比如AND、OR、XOR、NOT)或者更复杂一些的组合功能比如解码器或数学方程式。在大多数的FPGA里面,这些可编辑的元件里也包含记忆元件例如触发器(Flip—flop)或者其他更加完整的记忆块。系统设计师可以根据需要通过可编辑的连接把FPGA内部的逻辑块连接起来,就好像一个电路试验板被放在了一个芯片里。一个出厂后的成品FPGA的逻辑块和连接可以按照设计者而改变,所以FPGA可以完成所需要的逻辑功能。FPGA-般来说比ASIC(专用集成芯片)的速度要慢,无法完成复杂的设计,但是功耗较低。但是他们也有很多的优点比如可以快速成品,可以被修改来改正程序中的错误和更便宜的造价。厂商也可能会提供便宜的但是编辑能力差的FPGAO因为这些芯片有比较差的可编辑能力,所以这些设计的开发是在普通的FPGA上完成的,然后将设计转移到一个类似于ASIC的芯片上。另外一种方法是用CPLD(复杂可编程逻辑器件备)。早在1980年代中期,FPGA已经在PLD设备中扎根。CPLD和FPGA包括了一些相对大数量的可编辑逻辑单元。CPLD逻辑门的密度在儿千到儿万个逻辑单元之间,而FPGA通常是在儿万到儿白万。CPLD和FPGA的主要区别是他们的系统结构。CPLD是一个有点限制性的结构。这个结构由一个或者多个可编辑的结果之和的逻辑组列和一些相对少量的锁定的寄存器。这样的结果是缺乏编辑灵活性,但是却有可以预计的延迟时间和逻辑单元对连接单元高比率的优点。而FPGA却是有很多的连接单元,这样虽然让它可以更加灵活的编辑,但是结构却复杂的多。CPLD和FPGA另外一个区别是大多数的FPGA含有高层次的内置模块(比如加法器和乘法器)和内置的记忆体。因此一个有关的重要区别是很多新的FPGA支持完全的或者部分的系统内重新配置。允许他们的设计随着系统升级或者动态重新配置而改变。一些FPGA可以让设备的一部分重新编辑而其他部分继续正常运行。CPLD和FPGA还有一个区别:CPLD下电之后,原有烧入的逻辑结构不会消失;而FPGA下电之后,再次上电时,需要重新加载FLASH里面的逻辑代码,需要一定的加载时间。FPGA(现场可编程逻辑器件)产品的应用领域己经从原来的通信扩展到消费电子、汽车电子、工业控制、测试测量等广泛的领域。而应用的变化也使FPGA产品近儿年的演进趋势越来越明显:一方面,FPGA供应商致力于采用当前最先进的工艺来提升产品的性能,降低产品的成本;另一方面,越来越多的通用IP(知识产权)或客户定制IP被引入FPGA中,以满足客户产品快速上市的要求。此外,FPGA企业都在大力降低产品的功耗,满足业界越来越苛刻的低功耗需求。二、 工作原理FPGA采用了逻辑单元阵列LCA(ellArray)这样一个概念,内部包括可配置逻辑模块CLB(ConfigurableLogicBlock)>输出输入模块I0B(InputOutputBlock)和内部连线(Interconnect)三个部分。现场可编程门阵列(FPGA)是可编程器件,与传统逻辑电路和门阵列(如PAL,GAL及CPLD器件)相比,FPGA具有不同的结构。FPGA利用小型查找表(16X1RAM)来实现组合逻辑,每个查找表连接到一个D触发器的输入端,触发器再来驱动其他逻辑电路