文档介绍：浙江大学
硕士学位论文
DDRⅡ SDRAM控制器设计实现
姓名:陈肯
申请学位级别:硕士
专业:电路与系统
指导教师:沈海斌
20070501
刂破魃杓剖迪电路与系统陈肯
摘要
近年来,随着通信、计算机和多媒体技术的日益进步,对大数据流的存储和
处理提出了更高的要求。魑5诙鶧技术,已经广泛地应
用在各个领域,极大地满足了系统存储的需求,对于它的控制器的研究已经成为
熟点,是相当有意义和价值的。
本文中设计的刂破鞲涸鹆酉低澈屯饨拥哪诖妫菹低
的要求访问诖妫列词荨?刂破魃杓拼肓拷洗螅贒
上存在多路数据调度,多命令调度和多时钟域问题,其设计的好坏在后期的频率
提升、兼容性测试和性能验证中被证实有很大的影响。从频率和性能角度出发,
本次设计的刂破鳎獶内存内部的读写信息变为可
见,地址映射以地址为低地址,控制时序不用状态机而改用移位寄存器,
在考虑其功能的正确性同时,实现跨命令时序优化,提高了控制器频率,避免了
逻辑路径延时太大,达到了较高的带宽利用率和性能。同时为保证在整合到系统
中时,控制器能稳定工作,详细分析了控制器采集数据的时序窗口,在
上实现了延迟可配置性。并且加入了低功耗模块的设计,在诖娉な奔
不被访问时,控制器会自动使内存进入低功耗模式,减少了功耗。
本文首先介绍了墓ぷ魇毙蛱匦杂隓刂破鞯
功能、要求,然后例举了目前业界的较为普遍的设计架构,提出了本次的设计方
安,详细阐述了刂破魃杓剖迪钟胙橹ぃ⒂階镜目刂
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刂破魃杓剖迪电路与系统陈肯
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控制器设计实现电路与系统陈肯
图表目录
图表单元结构图⋯⋯⋯。
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图表毙蚴疽馔迹
图表时序示意图.
图表罘諨时序图.
图表毙蛱匦员冉.
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图表时序图⋯
图表毙蛲
图表毙蛲
图表毙蛲
图表毙蛲
图表时序图。
图表时序图
图表刂破魃杓瓶蛲
图表控制器所在系统框图
图表控制器设计整体框图.
图表地址排列方案一示意图。
图表地址捧列方案二示意图~
图表地址排列方案三示意图。
图表时钟控制模块结构框图
图表初始化状态机结构图⋯⋯⋯⋯⋯⋯。
图表地址映射图
图表刂酚成渫
图表时序图
图表低功耗控制状态机
图表读数据时序图
图表方案一羁刂谱刺
图表方案二刂破髯刺
图表连续访问礁鯾毙蛲
图表冲突例一
图表冲突例二
图表冲突例三
图表操作模式筋;号”勰力∞”跛核号
图表读写允许信号时序图一
图表读写允许信号时序图二
图表控制器时序图
图表时序图
图表误采保护电路时序图
刂破魃杓剖迪电路与系统陈肯
图表写数据时生成框图.
图表写数据时煽蛲
图表与列词毙蛲
图表读数据与煽蛲⋯⋯
图表读数据时序图
图表数据采集窗口时序图⋯⋯
图表时序分析示意图
图表资源表
图表分析表
图表分析表
图表刂破鱟试词褂帽
图表控制器资源使用表
图表丶肪斗治霰怼
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图表酆辖峁蠨刂破鞴丶肪妒就
图表复制寄存器前的即若构框图
图表复制寄存器后的框图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯
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图表测试基本框图⋯⋯⋯⋯⋯
图表譒蛲
图表“阶设计框图
图表单次操作性能比较.
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刂破魃杓剖迪电路与系统陈肯
表格目录
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表格刂酚成
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表格刂酚成洌
表格刂酚成
表格刂酚成洌
表格刂酚成洌
表格典型时序参数锟卓住笨壮诔凇
刂破魃杓剖迪电路与系统陈肯
髀
内存的发展
近十年来,随着多媒体技术、通讯技术相结合的信息时代的快速发展,
处理速度迅速提高和互联网的广泛应用,对内存的速度和各方面的性能的需求迅
速增加。而稍缙诘,发展到后来的,,髌
率已经到了极限,成为了系统性能的瓶颈。到年,双倍数据率
术开始兴起,在时钟上下边沿各传输一次数据,使得数据率为牧奖叮
频率也提高到畓,在提升性能地同时又不造成能耗的增加。
但随着扑闼俣鹊慕徊教岣撸隹刻岣咂德世刺嵘淼腄技术
也开始力不从心。来到年底,际蹩J冀肴嗣堑氖酉摺技
术是际醯慕徊椒⒄梗诒3稚舷卤