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B3G系统关键技术的FPGA设计与实现——同步、OFDM解调.pdf

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B3G系统关键技术的FPGA设计与实现——同步、OFDM解调.pdf

上传人:山吉 2014/3/3 文件大小:0 KB

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文档介绍

文档介绍:厣锏┐岳鸬论学位文毯骊刖奎尘进教授遭昱电壬科撞太堂成都通信皇信皇丕统电壬抖撞盔堂亟±——悖甉墨饷透碧饷拔瘛⒅俺啤⒀弧⒌ノ幻萍暗刂专业名称论文提交日期学位授予单位和日期答辩委员会主席评阅人年注⒚鳌豆适掷喾║的类分类号密级髡咝彰指导教师姓名申请学位级别月日
摘要近年来,随着人们对高速数据传输和多媒体业务需求的不断增长,多入多出和正交频分复用技术已成为无线移动通信领域的研究热点。由于能够显著改善频谱效率、提高数据传输速率和系统容量,—技术被广泛认为是后三代移动通信系统墓丶际酢H欢琌云德势品浅C感,因此同步技术也成为低车墓丶际踔唬甘芄刈ⅰ在国家“盕苹校缱涌萍即笱Ц涸養绞较翺下行链路的设计,其硬件实现主要是基于现场可编程门阵锌7ⅰ8链路由数字基带发送板、多天线发送板、多天线接收板、信道估计与扳和数字基带接收板构成。本文负责多天线接收板的开发工作,即针对同步、解调进行设计、编程实现、仿真测试和电路验证,最终实现滦辛绰返牧Mǎ瓜统性能符合设计要求。前两章概述了本文的研究背景、课题来源,并简单介绍了在本文设计中用到的开发工具、仿真软件、测试软件和所选器件等。主要器件为公司的酒虯镜哪J;黄鰽第三章详细介绍了下行链路中同步技术和解调的算法原理,并从硬件实现的角度对其进行了一定的改进。第四章首先简介全链路的总体硬件实现方案,然后对同步、解调部分各功能模块的设计进行详细阐述,给出各模块的实现结构框图和仿真波形图。主要包括时间同步模块、频率粗同步模块、频率精同步模块、定时恢复模块、尾帧检测模块、疉辅助模块、解调模块和疧接口模块等。第五章基于多天线接收板对设计进行了电路验证,通过件观测芯片内的状态转换、数据处理等信息,证明了设计的正确性。同时,对资源占用情况和系统运行速度进行了小结。最后,第六章对全文进行了概括性总结,明确了下一步有待进行的工作和未来的一些研究方向。关键词:現琌獾鳎奔渫剑德释
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图形列表ぷ髟怼内部结构框图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.插入循环前缀的符号⋯⋯..⋯⋯⋯⋯⋯⋯⋯⋯.⋯⋯⋯⋯一系统框图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.下行链路的系统帧结构⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..滦辛绰返幕究蚣同步时隙结构图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯时间同步的算法流程⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯系统基本模型框图..⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.滦辛绰返挠布低臣芄箍蛲肌多天线接收板的设计框图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.多天线接收板的算法流程⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯一同步模块的设计框图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.时间同步模块的结构框图⋯⋯⋯⋯⋯⋯⋯⋯⋯适应门限的结构框图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.⋯⋯⋯⋯⋯⋯⋯.时问同步模块仿真波形图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯频率粗同步模块的结构框图⋯⋯⋯⋯⋯⋯⋯图粗频偏估计子模块的结构框图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..图制灯ü兰谱幽?榉抡娌ㄐ瓮肌粗频偏补偿模块的结构框图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯盗胁方峁故疽馔肌⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯下行同步码结构图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.⋯⋯⋯⋯⋯⋯⋯..
州似蛳伽榔蚴§秘埘螂㈣化邶纠。:舛¨粥核的结构框图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.说氖毙虿ㄐ瓮肌频率精同步模块的结构框图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯一定时恢复模块的结构框图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯定时恢复模块的仿真波形图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯常见的结构框图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..累加型慕峁箍蛲肌相位比较器和募蚧峁箍蛲肌的仿真波形图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯同步信号的格式说明⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯虢涌诠叵低肌同步与解调芯片间数据传送格式⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯解调模块的设计框图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯送獠恳磐肌插入序号模块的结构框图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.插入序号后符号格式⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.插入序号模块的仿真波形图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.疧接口结构框图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.疧接口仿真波形图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯测试单路涌谀?榻邮照也ā测试多路涌谀?榻邮照也ā测试涌谀?榻邮帐导适荨⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..测试时问同步及尾帧检测模块⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯图图图图图图图图图图图图图图图图图图图图图图图疧内部结构框图.⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..图图形列表.
二二测试插入序号模块全局图⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯测试插入序号模块局部图⋯⋯⋯