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基于CPLD的多路数字开关电路的设计.pdf

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基于CPLD的多路数字开关电路的设计.pdf

文档介绍

文档介绍:单片机与可编程器件
基于的
多路数字开关电路的设计
· 长沙航空职业技术学院曾全胜·
摘要文中介绍了多路数字开关电路的基本结构及工作原理,采用语言实现了基于多路选择的数字开关电路,并通过
计算机仿真进行了验证。由于采用芯片来实现,因而具有高集成度与高可靠性的特点。
在现代工业自动控制系统、测量仪序仿真波形图。控制下实现增减计数,输出相应
器仪表及家用电子产品中,
各种多路机械触点的旋钮开关。这类开()多路选择模块的设计本模块的端,是从多路输入中选择一路输出。
关存在故障率高、换挡易错位、不易维护功能主要是从多路输入中选择一路输出, 所以可用一个带使能输入及同步清的
等缺点。本文提供的数字开关电路,不仅故可用一多路数据选择器来实现其功能, 进制增减计数器来实现。其
克服了机械开关的上述缺点,若采用不以选一多路数据选择器为例, 代码见本刊网站。
同的外围电路,还具有自动换挡、高速切为输入信号,选择控制()输入增量减量控制模块本
换等优点。信号应为位,其代码见本刊网模块主要实现两个功能,其一是根据输
.电路工作原理站()。入控制端的控制信号形成增减计数
图所示为多路数字开关电路主控()增减计数模块本模块的主模块所需的控制信号其二是形成计
数脉冲。根据工作原理部分的介绍,
故可将输入( 或
)的控制脉冲信号经整形形成计数
脉冲输出;而信号可由触发器来形
成。其代码见本刊网站。
.小结
本文以路数字开关电路为例进行
了设计,只要对代码稍加修改,便
可获得更多路数的选择。在

Ⅱ中按默认设置,进行时序逻辑性能分
析,其时钟频率

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