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高速低抖动全差分CMOS锁相环的研究设计.pdf

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高速低抖动全差分CMOS锁相环的研究设计.pdf

上传人:qujim2013 2013/9/8 文件大小:0 KB

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文档介绍

文档介绍:北京工业大学工学硕士学位论文迥坠竖兰鲤丛鹉ā晷怯ぁ鱈鲤卫壁£:塑造洼工程领域:邀电王皇固签鱼王堂研究方向:攫拯塞盛电路王皇巨熬攫导师姓名:职称:分类号:单位代码:学号:密级:公开论文报告提交日期:.生§旦塞王些态堂塞直塑圈匡垩垂圄学位授予日期:授予单位名称和地址:。
翮躲弛魏槲嗍赳、\日期:塑斗\弊烀独创性声明关于论文使用授权的说明本人声明所呈交的论文是我个人在导师指导下进行的研究工作及取得的研究成果。尽我所知,除了文中特别加以标注和致谢的地方外,论文中不包含其他人已经发表或撰写过的研究成果,也不包含为获得北京工业大学或其它教育机构的学位或证书而使用过的材料。与我一同工作的同志对本研究所做的任何贡献均已在论文中作了明确的说明并表示了谢意。本人完全了解北京工业大学有关保留、使用学位论文的规定,即:学校有权保留送交论文的复印件,允许论文被查阅和借阅;学校可以公布论文的全部或部分内容,可以采用影印、缩印或其他复制手段保存论文。签名:
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摘要锁相环频率合成器现在日益广泛地应用于通讯、微处理器系统中,并且随着集成电路的发展以及际醯某鱿郑壕晌3蠊婺<傻缏分胁豢苫蛉的模块。特别是无线通讯、高速处理器等领域,对锁相环电路的性能提出了越来越高的要求,锁相环电路工作在高速环境下己成为当前的一大挑战。本文在对锁相技术的发展历史和研究现状调查的基础上,从锁相系统的工作原理入手,分析了锁相环的数学模型。随后分析了锁相环稳定性、动态特性和噪声特性,得出了系统环路参数选择的原则,为后续电路设计和版图设计奠定理论基础。然后在电路结构上分析了传统电路实现的优缺点,并采用新的电路结构。主要有采用新的缏方峁梗媒峁贡苊饬宋O狼вΧ哟髍控制信号延迟时间所带来的丢掉时钟沿现象:采用新的电荷泵结构,用电阻代替传统的埽松了冈肷吹挠跋欤徊捎萌ú罘謗代替传统的单端徊郊跣〉缭丛肷訴造成的影响:采用高速偷退貲相结合的方式实现计数器。,芯片面积为。在输入参考频率为涑频率为保ㄊ奔湫∮桑奈胺翿约为关键词锁相环:高速:电荷泵;全差分环路滤波器:。
.甌。瓵,—幸..瑃瑆琽,籋籆:北京工、№大学工学硕貉宦畚,.【.瑃琭甌,,..Ⅱ
皇量曼葛鼍葛籣一灰唬甀鼍皇曼寰量鼍曼皇曼墨量置鼍曼曼鼍曼蔓皇蔓曼皇寰寰皇曼曼璺曼皇曹量皇皇量量目录摘要⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯一.⋯⋯⋯..第滦髀邸电荷泵锁相环的工作原理⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.电荷泵锁相环的噪声分析⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯课题背景⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯。国内外研究现状及挑战⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..锁相环的研究热点⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯。频率范围⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯一论文结构⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..第电荷泵锁相环的基本结构及组成模块⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.导嗥⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.箍卣竦雌⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯。.制灯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯电荷泵锁相环系统的线性模型⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯二阶电荷泵锁相环频率合成器⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯...椎绾杀盟嗷菲德屎铣善鳌本章小结⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.时间抖动和相位噪声⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.抑制抖动的方法⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯............................................................
电荷泵锁相环的电路设计⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯电荷泵锁相环的版图设计和物理验证⋯⋯⋯⋯⋯⋯⋯⋯..第本章小结⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯参数的选取和设计方法⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯鉴频鉴相器的设计⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯电荷泵的电路设计⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯..电荷泵的噪声仿真⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯。环路滤波器的设计⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯压控振荡器的设计⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯.

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