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四位二进制除法器说明书.doc

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四位二进制除法器说明书.doc

上传人:wz_198614 2017/10/6 文件大小:19 KB

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文档介绍

文档介绍:四位二进制除法器说明书
目录
一、设计目的????????????????????????? 1
二、设计要求????????????????????????? 1
三、设计内容????????????????????????? 1
、除法的实现?????????????????????? 1
、设计框图??????????????????????? 1
、功能说明??????????????????????? 1
、VHDL程序源代码??????????????????? 2
、VHDL程序说明???????????????????? 3
四、原理图和印刷板图????????????????????? 4 PCB板图?????????????????????? 4 Protel 原理图???????????????????? 5
五、设计结论?????????????????????????? 6
六、设计心得体会???????????????????????? 6
七、主要参考文献???????????????????????? 7
一、设计目的
1. 掌握电子电路的一般设计方法和设计流程;
2. 学****使用PROTEL软件绘制电路原理图及印刷板图。
二、设计要求
设计一个四位二进制除法器,具体要求如下:
1. 用键盘输入两个四位二进制数,并用数码管显示输入数。

3. 除数为零时,数码管黑屏,不显示任何内容。
三、设计内容
1、设计过程
除法实现的方案可以用VHDL语言实现。要想实现四位二进制除法器,必须首先实现除法的功能。
整个四位二进制除法器包括:输入电路,判断电路,除法电路,译码电路和显示电路。这些电路可以分别进行设计。
2、设计框图

●整个四位二进制除法器的实现可以分为以下5个部分:
●输入电路:输入两个4位2进制数A和B。它是通过连着高电平的8个开关 2
来实现的。
●判断电路:判断B是否为0。它是通过1个5输入同或门实现的。如果
B为0,输出端输出高电平,使能端除法器不工作,显示器黑屏。
●除法电路:由VHDL语言实现的。它实现两个4位2进制数相除,并输出商
y和余数r.
●译码电路:由VHDL语言实现的。它实现两个4位2进制数相除,
并输出商
y和余数r.
●显示电路:将译码器译成的数用数码管显示出来。

除法源代码
1. Library ieee;
2. Use ;
3. Entity divider is
4. Generic (n: integer :=3);
5. Port( a, b : in integer range 0 to 15;
6. y:out std_logic_vector ( 3 downto 0);
7. rest:out integer range 0 to 15;
8. err:out std_logic);
9. End divider ;
10.
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